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FPGA向けRTL設計補助

FPGA向けRTL設計補助

FPGA向けRTL設計補助及び検証 ・イメージセンサからの動画を、画処理して後段へ送付する。その他付随する庶務全般。

オススメポイント

大手グループ会社にてFPGA向けRTL設計補助業務をお任せ致します!!世界トップレベルの実力を誇るグループ会社にて就業になりますので、得られる知識や経験は飛躍的に自身をスキルアップしてくれます。エンジニアとして一流になれる環境です!!

この求人の詳細情報

募集職種 組み込み設計
勤務地 神奈川県横浜市中区
交通 JR桜木町駅より徒歩1分、またはみなとみらい線 馬車道駅より徒歩5分 最寄り駅 JR桜木町駅、みなとみらい線 馬車道駅
給与待遇 350,000円~460,000円+残業代(スキルに応じて変更有り)
応募資格 Verilogを使用した業務経験をお持ちの方歓迎!!
仕事内容 FPGA向けRTL設計及び検証 ・イメージセンサからの動画を、画処理して後段へ送付する。
勤務時間 9:00~18:00 就労期間 定時間8h
雇用形態 無期雇用 待遇・福利厚生 当社規定に準ずる                 ※受動喫煙対策あり(禁煙)
休日休暇 土日祝日
初年度年収 年収5,200,000円~6,900,000円を想定
企業名称 非公開 企業所在地 非公開
企業事業内容 非公開 企業HP 非公開
※詳しくは弊社担当者へお聞きください。

営業担当者からのひと言

世界トップレベルの実力を誇るグループ会社にて就業になりますので、得られる知識や経験は飛躍的に自身をスキルアップしてくれます。エンジニアとして一流になれる環境です!!是非ご応募ください!!

営業担当者名:伊藤 尚司